Felix Fietkau
18 years ago
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6a5f4ea179
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476c7769e5
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Index: linux-2.6.22-rc6/drivers/ssb/driver_mipscore.c
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--- linux-2.6.22-rc6.orig/drivers/ssb/driver_mipscore.c 2007-06-28 11:35:29.077307472 +0200
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+++ linux-2.6.22-rc6/drivers/ssb/driver_mipscore.c 2007-06-28 12:11:01.433140112 +0200
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@@ -128,10 +128,46 @@
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ssb_write32(mdev, SSB_IPSFLAG, irqflag);
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}
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-/* XXX: leave here or move into separate extif driver? */
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+static inline bool serial_exists(u8 *regs)
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+{
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+ u8 save_mcr, status1 = 0;
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+
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+ if (regs) {
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+ save_mcr = regs[UART_MCR];
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+ regs[UART_MCR] = (UART_MCR_LOOP | 0x0a);
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+ // Fixme UART_MSR_DSR appears in status1
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+ status1 = regs[UART_MSR] & 0xd0;
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+ regs[UART_MCR] = save_mcr;
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+ }
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+ return (status1 == (UART_MSR_DCD | UART_MSR_CTS));
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+}
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+
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static int ssb_extif_serial_init(struct ssb_extif *dev, struct ssb_serial_port *ports)
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{
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- return 0;
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+ u32 i, nr_ports = 0;
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+
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+ /* Disable GPIO interrupt initially */
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+ extif_write32(dev, SSB_EXTIF_GPIO_INTPOL, 0);
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+ extif_write32(dev, SSB_EXTIF_GPIO_INTMASK, 0);
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+
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+ for (i = 0; i < 2; i++) {
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+ void __iomem *uart_regs;
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+
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+ uart_regs = ioremap_nocache(SSB_EUART, 16);
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+ uart_regs += (i * 8);
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+
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+ if (serial_exists(uart_regs) && ports) {
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+ extif_write32(dev, SSB_EXTIF_GPIO_INTMASK, 2);
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+
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+ nr_ports++;
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+ ports[i].regs = uart_regs;
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+ ports[i].irq = 2;
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+ ports[i].baud_base = 13500000;
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+ ports[i].reg_shift = 0;
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+ }
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+ iounmap(uart_regs);
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+ }
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+ return nr_ports;
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}
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@@ -139,40 +175,6 @@
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{
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struct ssb_bus *bus = mcore->dev->bus;
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- //TODO if (EXTIF available
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-#if 0
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- extifregs_t *eir = (extifregs_t *) regs;
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- sbconfig_t *sb;
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-
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- /* Determine external UART register base */
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- sb = (sbconfig_t *)((ulong) eir + SBCONFIGOFF);
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- base = EXTIF_CFGIF_BASE(sb_base(R_REG(&sb->sbadmatch1)));
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-
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- /* Determine IRQ */
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- irq = sb_irq(sbh);
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-
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- /* Disable GPIO interrupt initially */
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- W_REG(&eir->gpiointpolarity, 0);
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- W_REG(&eir->gpiointmask, 0);
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-
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- /* Search for external UARTs */
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- n = 2;
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- for (i = 0; i < 2; i++) {
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- regs = (void *) REG_MAP(base + (i * 8), 8);
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- if (BCMINIT(serial_exists)(regs)) {
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- /* Set GPIO 1 to be the external UART IRQ */
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- W_REG(&eir->gpiointmask, 2);
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- if (add)
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- add(regs, irq, 13500000, 0);
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- }
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- }
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-
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- /* Add internal UART if enabled */
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- if (R_REG(&eir->corecontrol) & CC_UE)
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- if (add)
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- add((void *) &eir->uartdata, irq, sb_clock(sbh), 2);
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-
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-#endif
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if (bus->extif.dev)
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mcore->nr_serial_ports = ssb_extif_serial_init(&bus->extif, mcore->serial_ports);
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else if (bus->chipco.dev)
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@@ -219,7 +221,7 @@
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extif_write32(extif, SSB_EXTIF_PROG_WAITCNT, tmp);
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}
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-static inline void ssb_extif_get_clockcontrol(struct ssb_extif *extif,
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+void ssb_extif_get_clockcontrol(struct ssb_extif *extif,
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u32 *pll_type, u32 *n, u32 *m)
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{
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*pll_type = SSB_PLLTYPE_1;
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Index: linux-2.6.22-rc6/drivers/ssb/main.c
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--- linux-2.6.22-rc6.orig/drivers/ssb/main.c 2007-06-28 11:23:38.418344056 +0200
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+++ linux-2.6.22-rc6/drivers/ssb/main.c 2007-06-28 12:07:50.346189744 +0200
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@@ -774,12 +774,12 @@
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u32 plltype;
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u32 clkctl_n, clkctl_m;
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- //TODO if EXTIF: PLLTYPE == 1, read n from clockcontrol_n, m from clockcontrol_sb
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-
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- if (bus->chipco.dev) {
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+ if (bus->extif.dev)
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+ ssb_extif_get_clockcontrol(&bus->extif, &plltype, &clkctl_n, &clkctl_m);
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+ else if (bus->chipco.dev)
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ssb_chipco_get_clockcontrol(&bus->chipco, &plltype,
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&clkctl_n, &clkctl_m);
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- } else
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+ else
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return 0;
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if (bus->chip_id == 0x5365) {
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Index: linux-2.6.22-rc6/include/linux/ssb/ssb_driver_extif.h
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--- linux-2.6.22-rc6.orig/include/linux/ssb/ssb_driver_extif.h 2007-06-28 11:27:47.099538768 +0200
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+++ linux-2.6.22-rc6/include/linux/ssb/ssb_driver_extif.h 2007-06-28 11:28:03.482048248 +0200
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@@ -158,6 +158,8 @@
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/* watchdog */
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#define SSB_EXTIF_WATCHDOG_CLK 48000000 /* Hz */
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+extern void ssb_extif_get_clockcontrol(struct ssb_extif *, u32 *, u32 *, u32 *);
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+
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/* GPIO functions */
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static inline u32 ssb_extif_gpio_in(struct ssb_extif *extif,
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u32 mask)
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Index: linux-2.6.22-rc6/include/linux/ssb/ssb_regs.h
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--- linux-2.6.22-rc6.orig/include/linux/ssb/ssb_regs.h 2007-06-28 12:09:24.943808720 +0200
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+++ linux-2.6.22-rc6/include/linux/ssb/ssb_regs.h 2007-06-28 12:09:34.606339792 +0200
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@@ -24,8 +24,8 @@
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#define SSB_PCI_DMA_SZ 0x40000000 /* Client Mode sb2pcitranslation2 size in bytes */
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#define SSB_PCIE_DMA_L32 0x00000000 /* PCIE Client Mode sb2pcitranslation2 (2 ZettaBytes), low 32 bits */
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#define SSB_PCIE_DMA_H32 0x80000000 /* PCIE Client Mode sb2pcitranslation2 (2 ZettaBytes), high 32 bits */
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-#define SSB_EUART (SB_EXTIF_BASE + 0x00800000)
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-#define SSB_LED (SB_EXTIF_BASE + 0x00900000)
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+#define SSB_EUART (SSB_EXTIF_BASE + 0x00800000)
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+#define SSB_LED (SSB_EXTIF_BASE + 0x00900000)
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/* Enumeration space constants */
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